10G Ethernet PCS/PMA IP 核

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1 代码说明

2 时序说明

一个完整的10G以太网接口由10G PHY和10G MAC两个组成部分构成。在上一章节中，已经对MAC部分进行了阐述，本节将重点介绍PHY部分。通常情况下，会采用专门的PHY芯片来实现相关功能，目前vivado平台也提供了对应的IP核，即10G Ethernet PCS/PMA。

代码实现与功能说明

建议查阅RTL层级的原理图设计，对输入至核心模块的时钟信号与复位信号进行细致分析。

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