OpenRisc-36-ORPSoC的架构分析
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引言
此前，我们对ORPSoC的clock子系统与debug子系统进行了初步解析，从而对FPGA的上电、复位、配置、初始化以及用户模式等准备流程形成了基本认知。同时，对于ORPSoC的启动流程，包括程序烧录及上电后的加载等环节也有了初步的认识。为避免陷入片面理解或局部观察的误区，本小节将对ORPSoC的整体架构进行深入剖析，旨在从宏观层面把握其整体设计思路。
有关debug子系统的更多信息：<>
有关clock子系统的详细内容：<>
okay，let's go!
1，a general picture
在进行分析之前，形成对ORPSoC的初步感知，是一项不可或缺且具有实际意义的工作。在使用quartusII完成综合操作后所生成的模块连接图如下所示。
或许，从该图中难以直接获取有价值的信息，仅能看到杂乱无章的线路以及若干模块，而这些模块的名称也难以辨认清楚。
然而，这并无大碍，首先获得一个直观的印象：啊哈，原来如此！
就是这样。
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