Static Time Series Analysis: Setup and Hold Times
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1、概念：
建立时间（Tsu：setup time）
Ts最长持续时间为这个最短保持时间。
也就是说，在触发器的时钟信号上升沿到来之前维持数据稳定的时期称为保持期Ts。
当建立时间不足时无法在此时钟上升沿稳定地输入数据。
Ts即代表这个最短保持期。
保持时间（Th：hold time）
这是当触发器的时钟信号上升沿到来之后所维持输入的状态的时间段；若保持时间不足，则无法稳定地将输入发送到触发器中；而Th即为此最小维持时间。
触发器延迟时间（Tco：CLK-to-Q dealy of FF）
该触发器的反应速率是指从输入信号变化到影响输出所需的时间；换句话说，在输入信号变化后经过一段时间系统才会做出相应的反应。
组合逻辑延迟时间（Tcb：Combinational logic delay）
两个触发器之间的组合逻辑延迟。
2、建立时间分析
在图1中，虚线箭头标识时序路径。数据信号应在时钟边沿从触发器FF1的时钟端至触发器FF2的时钟端之前到达触发器FF2的数据端以实现可靠地存储数据。
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