[三态门原理]VHDL中INOUT双向口的应用

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在首次进行的VHDL实验过程中，需要完成如图所示的一种极为基础的逻辑功能实现任务：

鉴于VHDL用于描述逻辑功能的表达方式与C语言存在相似之处，仅需对VHDL语法进行初步了解，即可较为轻松地编写出实现相应逻辑功能的代码。

复制代码

 IF S="00" THEN

    
 	A<=C;
    
 ELSIF S="01" THEN
    
 	C<=A;
    
 ELSE
    
 	C<=B;
    
 END IF;

然而，此类仿真实验所得结果将呈现出如右图所示的“不确定”信号：

通过网络获取的代码与笔者原本构思的代码存在一定程度的差异：

复制代码

 IF S="00" THEN

    
 	C<="ZZZZZZZZ";A<=C;
    
 ELSIF S="01" THEN
    
 	A<="ZZZZZZZZ";C<

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