计算机组成原理的时序电路实验
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一、实验学时
4学时
二、实验目的
掌握节拍脉冲发生器的设计方法，理解节拍脉冲发生器的工作原理。
三、实验环境
硬件资源：PC机或笔记本电脑，康芯实验箱；软件资源：Quartus17.1设计平台。
四、实验原理
计算机之所以能够按照人们事先规定的顺序进行一系列的操作或运算，就是因为它的控制部分能够按一定的先后顺序正确地发出一系列相应的控制信号。这就要求计算机必须有时序电路，控制信号就是根据时序信号产生的。本实验说明时序电路中节拍脉冲发生器的工作原理。
某机器的连续节拍发生电路可由4个D触发器组成，如图3.1所示，该电路可产生4个等间隔的时序节拍信号T1–T4，其中CLK为时钟信号，当RST为低电平时，T1输出为“1”，而T2、T3、T4输出为“0”；当RST由低电平变为高电平后，T1–T4将在CLK的输入脉冲作用下，周期性地轮流输出正脉冲（脉冲宽度为一个时钟周期）。
（1）本实验的任务为实现连续节拍的发生电路设计。
其工作波形包括T₁-T₄以及CLK、RST信号，并可在图3-2中找到详细信息。
举例来说，顶层文件的路径为STEP-Ⅰ.bdf。
硬件部分的布局在图3-Ⅰ中进行展示。
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